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Kit FPGA DE10-Standard Altera Cyclone V SoC
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Description
Le kit de développement standard DE10 présente une plate-forme de conception matérielle robuste construite autour du FPGA Intel System-on-Chip (SoC), qui combine les derniers cœurs intégrés Cortex-A9 à double cœur avec une logique programmable de pointe pour une flexibilité de conception ultime. Les utilisateurs peuvent désormais tirer parti de la puissance d’une énorme capacité de reconfiguration associée à un système de processeur hautes performances et basse consommation. Le SoC d’Altera intègre un système de processeur dur (HPS) basé sur ARM composé d’un processeur, de périphériques et d’interfaces mémoire liés de manière transparente à la structure FPGA à l’aide d’une dorsale d’interconnexion à large bande passante. La carte de développement DE10-Standard comprend du matériel tel qu’une mémoire DDR3 haute vitesse, des capacités vidéo et audio, un réseau Ethernet et bien plus encore.
Dispositif FPGA
SoC Cyclone V SX—5CSXFC6D6F31C6N
110K LE, 41509 ALM
Mémoire embarquée de 5 761 Kbits
6 PLL FPGA et 3 PLL HPS
2 contrôleurs de mémoire dur
Système de processeur dur basé sur ARM (HPS)
Processeur MPCore ARM Cortex-A9 double cœur 925 MHz
512 Ko de cache L2 partagé
64 Ko de RAM Scratch
Contrôleur SDRAM multiport avec prise en charge de DDR2, DDR3, LPDDR1 et LPDDR2
Contrôleur d’accès direct à la mémoire (DMA) à 8 canaux
Configuration et débogage
Dispositif de configuration série – EPCS128 sur FPGA
USB Blaster II intégré (connecteur USB de type B normal)
Dispositif de mémoire
64 Mo (32Mx16) SDRAM sur FPGA
1 Go (2x256Mx16) SDRAM DDR3 sur HPS
Prise de carte MicroSD sur HPS
Communication
Deux ports hôtes USB 2.0 (interface ULPI avec connecteur USB de type A) sur HPS
USB vers UART (connecteur micro USB de type B) sur HPS
Ethernet 10/100/1000 sur HPS
Souris/Clavier PS/2
Émetteur/récepteur infrarouge
Connecteurs
Un connecteur d’extension à 40 broches (niveaux de tension : 3,3 V)
Un connecteur HSMC (normes d’E/S configurables 1,5/1,8/2,5/3,3 V)
Un en-tête d’entrée ADC à 10 broches
Un connecteur LTC (un maître d’interface périphérique série (SPI), une interface I2C et une interface GPIO) sur HPS
Afficheur
CNA VGA 24 bits
Module LCD 128 × 64 points avec rétroéclairage sur HPS
l’audio
CODEC 24 bits, prises d’entrée de ligne, de sortie de ligne et d’entrée microphone
Entrée vidéo
Décodeur TV (NTSC/PAL/SECAM) et connecteur d’entrée TV
ADC
Taux d’échantillonnage : 500 KSPS
Numéro de canal : 8
Résolution : 12 bits
Plage d’entrée analogique : 0 ~ 4,096 V
Commutateurs, boutons et indicateurs
4 clés utilisateur (FPGA x4)
10 commutateurs utilisateur (FPGA x10)
11 LED utilisateur (FPGA x10 ; HPS x 1)
2 boutons de réinitialisation HPS (HPS_RST_n et HPS_WARM_RST_n) Affichage 7 segments x6
Capteurs
Capteur G sur HPS
Alimentation
Entrée 12 V CC
Quick Comparison
| Settings | Kit FPGA DE10-Standard Altera Cyclone V SoC remove | Kit FPGA DE10-Nano Altera Cyclone V SE SoC remove | ALTERA FPGA EP2C8Q208C8N development board avec USB Blaster+TFT LCD 2.4+USB-TTL remove | ALTERA fpga Cyclone IV board (EP4CE6E22C8N) + USB BLASTER + LCD1602 remove | Kit FPGA DE0-Nano Altera Cyclone IV remove | XILINX câble de plate-forme USB FPGA CPLD JTAG SPI Débogueur, Programmateur remove |
|---|---|---|---|---|---|---|
| Image |  |  |  |  |  |  |
| SKU | C16A108 | C16A067 | C16A064 | C16A039 | C16A109 | C16A060 |
| Rating | ||||||
| Price | 6,000.00د.م. | 3,000.00د.م. | 1,150.00د.م. | 750.00د.م. | 1,600.00د.م. | 550.00د.م. |
| Stock | In Stock
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|
| Availability | In Stock | In Stock | Out of stock | Out of stock | In Stock | Out of stock |
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| Description |
| ALTERA Cyclone II Development Board |
| |||
| Content | Le kit de développement standard DE10 présente une plate-forme de conception matérielle robuste construite autour du FPGA Intel System-on-Chip (SoC), qui combine les derniers cœurs intégrés Cortex-A9 à double cœur avec une logique programmable de pointe pour une flexibilité de conception ultime. Les utilisateurs peuvent désormais tirer parti de la puissance d'une énorme capacité de reconfiguration associée à un système de processeur hautes performances et basse consommation. Le SoC d'Altera intègre un système de processeur dur (HPS) basé sur ARM composé d'un processeur, de périphériques et d'interfaces mémoire liés de manière transparente à la structure FPGA à l'aide d'une dorsale d'interconnexion à large bande passante. La carte de développement DE10-Standard comprend du matériel tel qu'une mémoire DDR3 haute vitesse, des capacités vidéo et audio, un réseau Ethernet et bien plus encore. Dispositif FPGA SoC Cyclone V SX—5CSXFC6D6F31C6N 110K LE, 41509 ALM Mémoire embarquée de 5 761 Kbits 6 PLL FPGA et 3 PLL HPS 2 contrôleurs de mémoire dur Système de processeur dur basé sur ARM (HPS) Processeur MPCore ARM Cortex-A9 double cœur 925 MHz 512 Ko de cache L2 partagé 64 Ko de RAM Scratch Contrôleur SDRAM multiport avec prise en charge de DDR2, DDR3, LPDDR1 et LPDDR2 Contrôleur d'accès direct à la mémoire (DMA) à 8 canaux Configuration et débogage Dispositif de configuration série – EPCS128 sur FPGA USB Blaster II intégré (connecteur USB de type B normal) Dispositif de mémoire 64 Mo (32Mx16) SDRAM sur FPGA 1 Go (2x256Mx16) SDRAM DDR3 sur HPS Prise de carte MicroSD sur HPS Communication Deux ports hôtes USB 2.0 (interface ULPI avec connecteur USB de type A) sur HPS USB vers UART (connecteur micro USB de type B) sur HPS Ethernet 10/100/1000 sur HPS Souris/Clavier PS/2 Émetteur/récepteur infrarouge Connecteurs Un connecteur d'extension à 40 broches (niveaux de tension : 3,3 V) Un connecteur HSMC (normes d'E/S configurables 1,5/1,8/2,5/3,3 V) Un en-tête d'entrée ADC à 10 broches Un connecteur LTC (un maître d'interface périphérique série (SPI), une interface I2C et une interface GPIO) sur HPS Afficheur CNA VGA 24 bits Module LCD 128 × 64 points avec rétroéclairage sur HPS l'audio CODEC 24 bits, prises d'entrée de ligne, de sortie de ligne et d'entrée microphone Entrée vidéo Décodeur TV (NTSC/PAL/SECAM) et connecteur d'entrée TV ADC Taux d'échantillonnage : 500 KSPS Numéro de canal : 8 Résolution : 12 bits Plage d'entrée analogique : 0 ~ 4,096 V Commutateurs, boutons et indicateurs 4 clés utilisateur (FPGA x4) 10 commutateurs utilisateur (FPGA x10) 11 LED utilisateur (FPGA x10 ; HPS x 1) 2 boutons de réinitialisation HPS (HPS_RST_n et HPS_WARM_RST_n) Affichage 7 segments x6 Capteurs Capteur G sur HPS Alimentation Entrée 12 V CC | Le kit de développement DE10-Nano présente une plate-forme de conception matérielle robuste construite autour du FPGA Intel System-on-Chip (SoC), qui combine les derniers cœurs intégrés Cortex-A9 à double cœur avec une logique programmable de pointe pour une flexibilité de conception ultime. Les utilisateurs peuvent désormais tirer parti de la puissance d'une énorme capacité de reconfiguration associée à un système de processeur hautes performances et basse consommation. Le SoC d'Altera intègre un système de processeur dur (HPS) basé sur ARM composé d'un processeur, de périphériques et d'interfaces mémoire liés de manière transparente à la structure FPGA à l'aide d'une dorsale d'interconnexion à large bande passante. La carte de développement DE10-Nano est équipée d'une mémoire DDR3 haute vitesse, de capacités analogiques-numériques, d'un réseau Ethernet et bien plus encore qui promettent de nombreuses applications passionnantes. Le kit de développement DE10-Nano contient tous les outils nécessaires pour utiliser la carte conjointement avec un ordinateur exécutant Microsoft Windows XP ou version ultérieure.
La carte DE10-Nano possède de nombreuses fonctionnalités qui permettent aux utilisateurs de mettre en œuvre une large gamme de circuits conçus, des circuits simples à divers projets multimédias.
Dispositif FPGA
| Déscription: | Déscription:
| La carte DE0-Nano présente une plate-forme de développement FPGA compacte adaptée au prototypage de conceptions de circuits telles que les robots et les projets "portables". La carte est conçue pour être utilisée dans l'implémentation la plus simple possible, ciblant le circuit Cyclone IV avec un maximum de 22 320 éléments logiques.
Les avantages de la carte DE0-Nano incluent sa taille et son poids, ainsi que sa capacité à être reconfigurée sans matériel superflu. Ces caractéristiques la distinguent des autres cartes de développement à usage général.
Tous les fichiers de conception du microcontrôleur Propeller à 8 noyaux de Parallax sont en code source libre.
| Description: Le câble de plate-forme USB, un câble compatible USB pour la configuration et la programmation en circuit de tous les appareils Xilinx. Aucune alimentation externe n'est requise. Un taux de transfert de configuration FPGA en série esclave soutenu de 24 mo/s est possible dans un environnement USB haute vitesse. Performance: Utilisation de la solution CY7C68013A + XC2C256, entièrement compatible avec le câble USB de la plate-forme XILINX d'origine Prend en charge tous les périphériques Xilinx, la configuration FPGA et la programmation PROM/CPLD Prend en charge JTAG, esclave-série et SPI Interfaces aux appareils fonctionnant à 5V (TTL), 3.3V (LVCMOS), 2.5V, 1.8V et 1.5V Fréquence d'horloge cible sélectionnable, prend en charge le réglage automatique de la fréquence du logiciel Prise en charge sur Windows et Red Hat entreprise Linux Détecte et s'adapte automatiquement à la tension d'e/s cible LED Indicateur D'état Les vitesses d'horloge cibles sont sélectionnables de 750 kHz à 24 MHz. Logiciel pris en charge Xilinx ISE 8 à ISE 14.7 et logiciel ISE à jour Xilinx Vivado IMPACT ChipScope Microblaze processeur embarqué débogage Appareil pris en charge: Tous les appareils Xilinx, FPGA et PROM/CPLD: Toutes les familles Virtex-FPGA Toutes les familles sparte-FPGA XC9500 / XC9500XL / XC9500XV Cpld CoolRunnerXPLA3 / CoolRunner-II CPLDs XC18V00 FAI PROMs Plateforme Flash XCF00S/XCF00P/XL PROMs XC4000 série Fpga Nouveaux appareils Xilinx, y compris V7, Z7, etc. Emballage Inclus: 1 * câble de plate-forme USB 1 * JTAG adaptateur 1 * câble USB 2.0 Câble robin séparé 1*8 broches à 7 broches Câble plat JTAG 1*14 broches (pas de 2.5mm) Câble plat JTAG 1*14 broches (pas de 2mm) Câble plat JTAG 1*10 broches (pas de 2.5mm) |
| Weight | 0 | 0 | 0 | 0 | ||
| Dimensions | ND | ND | ND | ND | ND | ND |
| Additional information |
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